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Synthèse VHDL

  • Composante

    ENSEIRB-MATMECA

Code interne

EE7EN201

Description

Les langages de description de circuits intégrés:
- Contexte
- Le langage VHDL
- La synthèse des circuits numériques

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Syllabus


Cours:


Le langage VHDL pour la synthèse
Le langage VHDL, notions avancées (generic, package, etc)
Les FPGA, architecture interne des circuits programmables
La synthèse: de la description VHDL à l'implantation sur FPGA


Les TDs


Rappel et mise en oeuvre du langage VHDL en vue des séances sur machine,
Synthèse logique à la main de composant VHDL élémentaires.


Les TDs efectués sous environnement CAO


Formation aux outils en vue du projet de conception VHDL (EN202)

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Informations complémentaires

NON DISPENSE EN 2024-2025

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Modalités de contrôle des connaissances

Évaluation initiale / Session principale - Épreuves

Type d'évaluationNature de l'épreuveDurée (en minutes)Nombre d'épreuvesCoefficient de l'épreuveNote éliminatoire de l'épreuveRemarques
Epreuve TerminaleEcrit1200sans document calculatrice autorisée

Seconde chance / Session de rattrapage - Épreuves

Type d'évaluationNature de l'épreuveDurée (en minutes)Nombre d'épreuvesCoefficient de l'épreuveNote éliminatoire de l'épreuveRemarques
Epreuve terminaleEcrit1200sans document calculatrice autorisée