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Composante
ENSEIRB-MATMECA
Code interne
ES8EN227
Description
L'objectif de cet enseignement est de faire comprendre les enjeux liés à la vérification des systèmes numériques lors de leurs phases de conception. Afin d'améliorer les processus de conception et réduire le temps de développement, les méthodes usuelles employées lors de la conception de systèmes numériques sont détaillées. Enfin, ces méthodes sont mise en oeuvre durant une séquence de TDs/TPs à l'aide des langages C et VHDL.
Pré-requis obligatoires
Une matrise des langages C/C++ et VHDL est nécessaire.
Syllabus
Partie 1: Les enjeux de la vérification des systèmes
Partie 2: Les méthodes de vérifications
Partie 3: Les outils de vérification pour le développement logiciel.
Partie 4: Les outils de vérification pour le développement matériel.
Informations complémentaires
Vérification, Cycle en V, Programmation logicielle (C/C++), Architectures matérielles (VHDL), testbench
Modalités de contrôle des connaissances
Évaluation initiale / Session principale - Épreuves
| Type d'évaluation | Nature de l'épreuve | Durée (en minutes) | Nombre d'épreuves | Coefficient de l'épreuve | Note éliminatoire de l'épreuve | Remarques |
|---|---|---|---|---|---|---|
| Projet | Contrôle Continu | 1 |